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moonm
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LV pour cRIO

Bonjour

 

j'utilise cRIO avec le module NI 9870

J'ai déplacé l'exemple qui vient avec LV de NI 9870 dans mon projet.

Mais j'ai une liste d'erreurs que je ne sais pas comment la corriger.

 

J'ai attaché des images(.png) pour clarifier.

 

J'espère avoir été assez clair.... Donc merci à tous ceux qui pourront m'aider .

Member
lemaiste
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Re : LV pour cRIO

Bonjour,

 

Il te manque le FPGA Bitfile  (fichier avec un attention dans les dépendances de ton projet).

 

Du coup, je pense que tes erreurs viennent de là.

 

Cordialement.

Member
moonm
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Re : LV pour cRIO

Bonjour

 

Et comment obtenir le FPGA Bitfile?

 

je croi que le FPGA Bitfile est géneré par le compilateur Xilinx aprés la géneration du code VHDL par LabVIEW FPGA

Member
moonm
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Re : LV pour cRIO

Je ne peux pas faire glisser le port de la fenêtre de projet au diagramme FPGA! je ne sais pas pourquoi!

 

Je pense que quelque chose s'est foiré quand j'ai copié l'exemple. Y at-il des règles à suivre pour déplacer l'exemple??

 

 

Member
moonm
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Re : LV pour cRIO

Bonjour lemaiste

 

C'est bon maintenant j'ai corrigé les erreurs dans le FPGA VI par faire ça:

hmd.png

 

Mais j'ai un probleme de compilation..j'ai attaché une image(.png) de l'erreur

Comment corriger ça?




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